Diese Dissertation stellt neuartige Schaltungskonzepte zum Senden und Empfangen von seriellen Datenströmen höchster Datenraten vor. Ziel ist es, eine Anordnung zu finden, die für eine gegebene CMOS-Fertigungstechnik die maximale Übertragungsdatenrate ermöglicht. Es wird ein Konzept für das Senden von Daten vorgestellt, das als einzig bekanntes eine Senderate ermöglicht, die um ein Vielfaches über der Betriebstaktfrequenz des Senders liegt. In der Folge wird ein neues Verfahren der Takt/Datenrückgewinnung eingeführt. Es erlaubt, analog zum Sender, den Betrieb des Empfängers bei einer gegenüber der Datenrate um ein Vielfaches herabgesetzten Taktfrequenz. Die wichtigsten Vorteile der neuen Sender/Empfängeranordnung sind: geringe Leistungsaufnahme, Einsatz nur eines Oszillators in Master- und Slave-Betrieb, minimale Anzahl schneller Komponenten, keine hochfrequente Taktverteilung, Begrenzung der Datenrate nur durch die Bandweite der Ein- und Ausgangsstufen
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